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TU Berlin

Inhalt des Dokuments

AES Projekt

Lehrveranstaltungsdaten
Veranstaltung
AES Projekt (Projekt Architektur eingebetteter Systeme)
Veranstaltungsnr.:
0433 L 231
Bewertung/Gewichtung:
4 SWS / 6 ECTS
Modulbezeichnung:
MINF-SE-AEP.W10
Studiengänge:
Technische Informatik, Informatik, andere
Zeit:
Mi 10-14 Uhr, wöchentlich, 20.10.2010 bis 16.2.2011
Ort:
FR3038
Kontakt:
aep@aes.cs.tu-berlin.de oder

Aufgabenstellung

Eine gegebene VHDL-Beschreibung eines eingebetteten Systems (32-Bit-RISC-Prozessors, Speicher, UART, etc.) soll unter verschiedenen Gesichtspunkten optimiert und erweitert werden:

     

  • CPU-Leistungsoptimierung. Optimierung der Prozessorbeschreibung um den

    Durchsatz und/oder die Taktfrequenz zu erhöhen; von der Multi-Cycle- zur

    Pipeline-Architektur.

  • Systemstrukturoptimierung. Identifikation und Beseitigung von

    Performanz-Flaschenhälsen (z.B. Optimierung der Speicherhierarchie);

    Implementierung oder Einbau Standard-konformer Geräte/Systemstrukturen

  • Dokumentations- und Qualitätsverbesserung. Verbesserung der

    Code-Umgebung sowie der -Realisierung (Dokumentations- und Qualitätsaspekte)

  • Hardwarenahe Softwareentwicklung. Boot-Loader/Bootstrap-Code

    Entwicklung bzw. Anpassung; Entwicklung geeigeneter Testprogramme

    (Hardwarenahe Softwareentwicklung)

  •  

Ablauf

     

  • Kurzeinführung zu Beginn des Semesters

  • Gruppeneinteilung (bei geringer Teilnehmerzahl: ein Team)

  • Zeit für Analyse/Einarbeitung; Semesterplanerstellung durch Team(s)

  • Wöchentlicher (zweiwöchentlicher?) Kurzbericht: Erreicht/Nicht erreicht in

    der letzten Woche, Ziele für die nächste Woche

  • Abschlusspräsentation, Rücksprache und Code-Diskussion am Ende des Semesters

  •  

Literatur

Prozessor- und Systemarchitektur

     

  • Computer Organization & Design bzw. Recherorganisation und -entwurf (David A. Patterson, John L. Patterson)

  • MIPS RISC Architecture (Gerry Kane, Joe Heinrich)

  • Mikroprozessortechnik und Rechnerstrukturen (Thomas Flik)

  • Moderne Prozessorarchitekturen (Matthias Menge)

  •  

VHDL

     

  • The Designer’s Guide to VHDL (Peter J. Ashenden)

  • VHDL-Cookbook (Peter J. Ashenden)

  • VHDL-Kompakt (Andreas Mäder)

  •  

 

Zusatzinformationen / Extras

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